數位電路中觸發器中關於現態和次態的高階問題,高手進

2021-05-24 23:29:44 字數 515 閱讀 2762

1樓:黑豹

「次態和現態本就是一根線上不同時刻的狀態,二者不可能同時存在」,這正是回時序邏輯性質的關鍵點:答邏輯狀態和時間有關,這個時間是用時鐘做最小單位的。

「在狀態轉變的時候需要有輸入的促使,而這個輸入在狀態轉變過程中必須穩定不變,但是這個輸入裡又包括自己的反饋,」這個反饋訊號是上一個時鐘週期觸發器的輸出訊號,現在的輸出訊號要等到現在的時鐘有效時才產生,而輸出結果產生後意味著時鐘失效,此時反饋訊號的改變已經不影響本次的輸出,影響的是下一次時鐘週期的輸出。

t+1時鐘的輸入狀態=t+1時刻的輸入狀態+t時刻輸出狀態的反饋訊號。

2樓:匿名使用者

觸發器的狀態改變,需要有時鐘訊號控制,在次態出現之前,輸入不會改變。

3樓:梔槿

基本sr鎖存器的電路結構圖看下就懂了

4樓:匿名使用者

因為有時鐘 一個始終邊沿 就像一道指令

讓觸發器 按照現態狀態 跳變一次

這個觸發器電路波形圖怎麼畫,數字邏輯 d觸發器 波形圖怎麼畫呀

這是一bai個真實的電路圖,du要考慮訊號輸入到觸發器輸zhi出的延時時間。dao 時鐘同時載入在回兩個觸發器上,時答鐘的有效時刻是一致的,第一個觸發器輸出改變時,第二個觸發器的觸發有效時刻已經過去,所以訊號傳遞要推遲一個時鐘週期。根據以下觸發器的性質畫波形圖 j 1,k 0時,qn 1 1 j 0...

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